• 面議(經常性薪資達4萬元或以上) 台北市大安區 工作經歷不拘 6天前更新
    ◼學歷:國內外研究所(資訊、電機、資工、資管、電信)等相關系所畢業 ◼工作內容: 1.B5G/6G 行動網路技術研發 2.B5G/6G 網路軟體化技術研發 3.B5G/6G 行動網路管理技術研發 ◼所需專長及相關經驗:(至少具備以下任一) 1.熟悉無線通信理論與數位信號處理技術 2.熟悉多天線信號處理運作及無線效能解決技術 3.熟悉SDN、NFV 網路功能軟體化與虛擬化技術 4.熟悉LTE 與5G 核心網路技術 5.熟悉PyTorch/Keras 等AI/ML 框架訓練、調校與整合應用能力 6.操作MySQL/MSSQL/PostgreSQL 或其他關聯式資料庫系統之經驗 ◼具備以下資格尤佳: 1.熟悉5G 與衛星通信相關標準與技術 2.具備3GPP 行動通訊標準或衛星通訊知識者 3.具備AWS/Azure/GCP 等雲平台操作與管理經驗 4.具備容器化、微服務開發經驗 5.3GPP 核心網路相關技術與系統研發經驗 6.APIService 與網頁研發經驗 ◼報名網址:https://rmis.cht.com.tw/portal/career/index.jsp
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 3年工作經驗 3天前更新
    工作內容: 1.開發NVMe SSD腳本 2.腳本分析與釐清問題
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 工作經歷不拘 3天前更新
    工作項目: Verification for High Speed PHY projects, which includes: 1. Responsibility for test plans, testbench documentation and implementation. 2. Use SystemVerilog language, SVA and UVM methodology for block level verification. 3. Debug tests with design engineers to deliver functionally correct design blocks. 4. Close coverage measures to identify verification holes and show progress towards tape-out. 5. Write scripts to automate routine parts of verification workflow. 應徵條件: 1. 碩士以上; 電子、電機、資工、電信、電控、資科等相關科系畢業為主。 2. 具0~3年下列經驗之一者尤佳: (1) Experience verifying digital logic at RTL using SystemVerilog for FPGAs and/or ASICs. (2) Experience verifying digital systems using standard IP components/interconnects. (3) Experience creating and using verification components and environments in standard verification methodology. 3. Preferred qualifications: (1) Experience with high speed MAC/PHY RTL design or verification. (2) Experience with UVM methodology and coding. (3) Good English verbal communication skills.
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 3年工作經驗 3天前更新
    Business development manager for Latin America region, focusing on local telco, brand-names, and partners.
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 3年工作經驗 3天前更新
    徵才條件: 1. 碩士以上電機資訊相關科系畢 2. 熟悉 Verilog RTL 及 Synthesis, Simulation 等相關 IC Design Flow 3. 熟悉 Computer Architecture 4. 有下列經驗者更佳: (1)Microprocessor或DSP相關硬體設計 (2)On-chip Bus, DDR/Flash Memory Controller, PCIE, USB等設計
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 3年工作經驗 3天前更新
    工作內容: 1.開發與維護自動化環境,收集資料彙整入資料庫系統 2.部門需求軟體開發與維護
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 工作經歷不拘 3天前更新
    Verification for microprocessor designs. Desired skills and experience includes: 1. Experience in processor design verification: test planning, testbench development, and documentation 2. Knowledge of assembly language, C/C++ and/or SystemVerilog 3. Knowledge of SVA or UVM methodology for block and top level verification 4. Formal property checking/formal verification methodologies 5. Proficiency in scripting languages such as Python/Perl
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  • 面議(經常性薪資達4萬元或以上) 新竹市東區 工作經歷不拘 3天前更新
    Microprocessor design. Desired skills and experience includes: 1. Knowledge of DSP, microprocessor and computer architecture fundamentals. 2. Experience in RTL design and ability to make trade-offs between power, performance and area appropriately. 3. Experience in the microprocessor design cycle: initial concept, micro-architecture, implementation, verification, documentation and support.
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  • 月薪30000~60000元 新竹市東區 工作經歷不拘 3天前更新
    瑞昱半導體【科技專才創造力學程實習計劃】將提供本計劃實習生: 1. 科技專才培育:規劃實習同仁專屬五大面向課程,培養專業、開發思考與創造力。 2. 賦予研究專題與實質任務。 3. 科別專責輔導員:每位實習生設有專屬輔導者,協助專業學習及問題引導。 實習期間:於2024年7月1日(一)至2024年8月30日(五)專案實習與活動安排。 實習時間:週一至週五8:30-17:30,週休二日。 實習地點:瑞昱新竹一、二及三廠廠區。 招募對象: 大三(含)以上、碩士班或博士班之電子、電機、電信、電控、資工、資科等相關科系在學生,具下列任一條件者佳: a. 熟C、C++、Assembly、Linux、SPICE、Matlab、Cadence EDA環境。 b. 熟類比電路設計、信號處理相關領域或有興趣者。 c. 熟ADC、PLL相關領域或有興趣者。 d. 對通訊網路、聯網多媒體、多媒體、電腦週邊產品或電路設計有濃厚興趣者。
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  • 月薪30000~60000元 新竹市東區 工作經歷不拘 3天前更新
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  • 月薪30000~60000元 新竹市東區 工作經歷不拘 3天前更新
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